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All Programmable SoC를 이용하여 유연하며 완전한 기능을 갖춘 디지털 무선 솔루션을 효율적으로 구현하는 방법

2015-08-18 08:30~12:10

XILINX / 정 웅 부장

웨비나정보 웨비나Q&A

  • 이*용2015-08-18 오전 10:55:12

    dsp 48 구성에서 ff 의미는 무엇인지요

  • xilinx12015.08.18

    internal register 입니다.

  • 이*용2015-08-18 오전 10:54:24

    dsp48 회로 구성에서 c,p 의미가 무엇인지요

  • xilinx22015.08.18

    DSP48 Primitive (ug479_7Series_DSP48E1.pdf 파일 참조) 1. C 포트: Data input to the second-stage adder/subtracter, pattern detector, or logic function. 2. P port 연산 출력 포트 : Data output from second stage adder/subtracter or logic function.

  • 이*용2015-08-18 오전 10:52:11

    dynamic range 은 얼마인지요

  • xilinx12015.08.18

    무엇에 대한 Dynamic range 인지요?

  • 이*용2015-08-18 오전 10:51:33

    short delay line 은 몇 대략 ms 인지요

  • xilinx12015.08.18

    ms 단위가 아닙니다. sample 단위입니다. sample rate 은 100~250MPSs 이기 때문에 대략 4~10ns입니다. 몇 sample delay는 수십 ns 정도로 보시면 됩니다

  • 장*호2015-08-18 오전 10:51:25

    Dual LUT5와 Dual RAM32와 Dual SRL16 중 어느 것이 더 빠른가요?

  • xilinx22015.08.18

    그것은 DC 데이타 시트를 참고해야 합니다. ds182_Kintex_7_Data_Sheet.pdf

  • 이*용2015-08-18 오전 10:50:00

    dsp48 와 bram 차이점이 무엇인지요

  • xilinx32015.08.18

    DSP48은 Filter설계에 적합한 Multiplier와 Accumulator등이 들어있는 Logic이고 BRAM은 Block Memory의 약자로 7 Series의 경우 36Kb기본 단위로 구성된 Memory Logic입니다.

  • 김*호2015-08-18 오전 10:48:31

    [질문] 스칼라 방식의 파이프라인 아키텍쳐일까요?

  • xilinx22015.08.18

    FPGA내부의 Fmax, 즉 타이밍을 올리기 위하여 Register/Flip Flop을 사용하는 것입니다.

  • 무명2015-08-18 오전 10:48:23

    PIMD 제거용 Xilinx Libray가 있는지요?

  • xilinx12015.08.18

    공식 library는 없습니다. 하지만 DPD feedback path를 이용하여 PIMD cancellation algorithm을 C 를 이용하여 VHLS로 구현 가능합니다.

  • 이*용2015-08-18 오전 10:48:18

    pipeling 은 설개 개념을 의미 하는것인지요

  • xilinx12015.08.18

    설계 개념이라기 보다는 구현 관점에서 타이밍 성능을 올려주기 위한 방법입니다.

  • 조*정2015-08-18 오전 10:47:41

    spartan 6도 VIVADO 환경에서 안되나요?

  • xilinx22015.08.18

    네, 지원하지 않습니다.
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